De acordo com pt.wedoany.com-A Panmnesia anunciou que sua tecnologia de controlador e switch Fabric CXL (Compute Express Link) de próxima geração foi aceita no "ISCA 2026", a conferência acadêmica de maior autoridade na área de arquitetura de computadores.
O ISCA 2026 será realizado de 27 deste mês a 1º do próximo mês em Raleigh, Carolina do Norte, EUA, sendo uma conferência acadêmica de renome internacional na área de arquitetura computacional. Recentemente, com a popularização de aplicações em larga escala, como agentes de IA, a demanda por capacidade de memória cresceu significativamente. Nesta edição do ISCA, a Meta e a Panmnesia publicarão artigos relacionados ao CXL.
A tecnologia divulgada pela Panmnesia difere da abordagem tradicional, que conecta dispositivos de memória diretamente à Unidade Central de Processamento (CPU). A nova tecnologia utiliza switches CXL para conectar mais dispositivos, ao mesmo tempo que oferece baixa latência e alta largura de banda.
O CXL compartilha a interface física com o PCIe. Por isso, é comum modificar o IP (Propriedade Intelectual) de design existente para desenvolver rapidamente controladores. No entanto, manter as operações do design PCIe inalteradas resulta em latência adicional. O controlador CXL de próxima geração desenvolvido pela Panmnesia aprimora isso, suportando menor latência. A principal mudança é a substituição do processo de configurar buffers separados e gerenciar temporizações individualmente em cada camada por uma estrutura de buffer compartilhado entre diferentes camadas, reduzindo significativamente a sobrecarga de sincronização. Além disso, com otimizações adicionais em cada camada, a latência do controlador foi melhorada.
No que diz respeito ao switch CXL, a nova tecnologia suporta roteamento baseado em porta (PBR). Diferente do roteamento baseado em hierarquia (HBR), que anteriormente só permitia conectar dispositivos em uma estrutura hierárquica, o PBR permite que os dispositivos sejam conectados em qualquer formato, formando uma estrutura Fabric entrelaçada. O switch CXL de próxima geração da Panmnesia suporta tanto PBR quanto HBR, podendo otimizar ainda mais os caminhos de transmissão de dados. A empresa explica que, combinado com seu controlador CXL que reduz a sobrecarga de sincronização, a latência pode ser ainda mais reduzida.
A Panmnesia enfatiza que, em comparação com a abordagem comum anterior de conectar dispositivos multi-host (MHD) diretamente à CPU, esta tecnologia permite uma expansão de memória em maior escala, mantendo latência comparável e alta largura de banda. O artigo destaca especialmente que, ao conectar 64 servidores através do switch Fabric CXL de próxima geração, o desempenho permanece estável.
A Panmnesia afirma que continuará otimizando o switch CXL de próxima geração apresentado no ISCA, desenvolvendo um switch integrado PCIe 6.4-CXL 3.2, e já obteve um chip de pré-lançamento. Com base na otimização contínua da tecnologia, o controlador CXL de próxima geração adicionou funcionalidades do padrão mais recente CXL 4.0, sendo comercializado como "IP combinado PCIe 7.0-CXL 4.0".
O representante da Panmnesia, Jeong Myung-soo (정명수), destacou que, no passado, a indústria geralmente acreditava que adicionar um switch entre a CPU e os dispositivos dificultava atender aos requisitos de latência de acesso à memória, tornando a conexão direta do MHD à CPU a abordagem dominante. Ele afirmou que este estudo demonstra que essas características não são limitações inerentes ao CXL ou aos switches CXL, mas sim características do CXL inicial, e que, com o amadurecimento dos padrões e produtos relacionados, esse problema pode ser resolvido. Através do switch Fabric equipado com o controlador CXL de próxima geração, é possível alcançar simultaneamente alta escalabilidade, baixa latência e desempenho de processamento estável, e confirmar isso tem grande significado.
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